技術開発≪IC回路・ASIC回路≫/通信モジュール・センサー 社名非公開
| 企業名 | 社名非公開 |
|---|---|
| 年収 | 500万円 〜 900万円 |
| 勤務地 |
神奈川県
詳細につきましてはご面談時にお伝え致します |
| 職種 | 技術開発≪IC回路・ASIC回路≫/通信モジュール・センサー |
| 業種 | 半導体・電子・電気機器業界のデジタルIC設計 |
| ポイント | パソナキャリアがおすすめする求人案件です。こちらの求人以外にも非公開求人も多数保有しておりますので、転職をお考えの方は、是非エントリーください。 |
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正社員
完全週休二日制年間休日120日以上平均残業月30時間以内社宅・家賃補助制度
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募集要項
| 仕事内容 |
【職務内容】 ≪概要≫ 通信モジュール向け制御ICやセンサーASICのディジタル回路設計において、RTL設計またはレイアウト設計を主に行っていただきます。 ≪詳細≫ ■デジタル回路フロントエンド設計および検証 ■デジタル回路バックエンド設計および検証 ※連携地域…野洲事業所（滋賀）、本社（京都）、米国、ヨーロッパ 【携わる商品】 通信モジュールの制御ICおよびセンサーASIC 【働き方特徴（出張頻度や勤務形態など）】 ■フレックス／テレワーク制度有り ■年に数回、連携地域への出張の可能性があります。 【この仕事の面白さ・魅力】 ■新しい通信規格（5G、6G）や次世代センシング技術を見据えた、将来の商品につながる技術開発に携わることができます。 ■同社として多くの強い高周波部品を開発・保有していることで、海外複数拠点を含む世界最先端の色々な地域の技術者との協業が可能です。 ■自身で開発プロジェクトを発案したり実際にリードしたりすることも可能で、世界初の新商品・新技術を世に送り出す経験も魅力です。 ■新商品を市場に提供する事で、社会発展への貢献を実感する事が出来ます。 |
|---|---|
| 求める人材 | 【必須要件】 ■ASICまたはFPGAのデジタル回路の設計開発の経験 ※以下1～8のいずれかの実務経験が2年以上ある方 1.verilog HDLによるディジタル回路の論理設計および検証 2.論理合成および等価性検証 3.フロアプラン、電源設計 4.Place&Route 5.TimingDrivenLayout設計フロー 6.タイミングECOの作成 7.DRC/LVS、クロストーク、IR-dropの検証 8.PDK変更などのディジタル設計環境の構築 【求める人物像】 ■チームや社内外の関係者と協働しながら業務を行いたい方 |
給与・待遇
| 給与 |
年収 500 ～ 900 万円 経験・スキルに応じて変動の可能性があります |
|---|---|
| 雇用・契約形態 | 正社員 |
| 募集ポジション | 技術開発≪IC回路・ASIC回路≫/通信モジュール・センサー |
勤務時間・休日
| 勤務時間 | 09:00～17:30 |
|---|---|
| 休日・休暇 |
完全週休二日（土日）祝日 ※同社カレンダーに基づく 夏期休暇、お盆、年末年始、GW、有給休暇、半日有給休暇、慶弔休暇、産休・育児休暇、介護休暇、特別休暇、自己啓発支援特別休暇、自己実現特別休暇 |
その他
| 募集背景 | 増員のための募集になります。詳細につきましてはご面談時にお伝え致します。 |
|---|---|
| コンサルタントからのコメント | パソナキャリアがおすすめする求人です。詳細は面談時にお話しさせていただければと思いますので、まずはお気軽にエントリーください。 |
企業情報
| 企業名 | 社名非公開 |
|---|---|
| 設立 | 1950年 |
| 従業員数 | 10089 |
| 資本金 | 69,444百万円 |
| 事業内容 | 非公開求人のため、求人の詳細はご面談時にお伝え致します。まずはお気軽にご応募ください。 |
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