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半導体設計エンジニア(マネージャー候補) 株式会社シーディア

掲載開始日:2024/03/26
更新日:2025/01/11
ジョブNo.404638016
職種 半導体設計エンジニア(マネージャー候補)
社名 株式会社シーディア
業務内容 【職務概要】
半導体製品(デジタル/アナログ)の開発におけるフロントエンド、ミドルエンド、バックエンドの設計に及ぶテスト/法科業務等、ご経験や適性に応じていずれかお任せいたします。

【職務詳細】
■プレイヤー業務
デジタル:RTL設計/検証/タイミング検証/STA/DFT/P&R/インプリ/FPGA
アナログ:各種アナログIP設計/レイアウト/実験評価 等
■マネジメント業務
メンバー育成:モチベーション管理及び、技術向上に向けて、オンラインや対面でコミュニケーションを取っていただきます

★備考--------------------------------
プロジェクト先に常駐して就業して頂きます。
主な常駐先は、ルネサスエレクトロニクス、ソニー、日立、東芝、キヤノン等大手半導体メーカーが中心です。
大手メーカー出身のベテランエンジニアからOJTを受けることができます。
求める経験 【必須】
・デジタルまたはアナログの設計経験
・下記いずれかの使用経験
VerilogHDL、SystemVerilog、NC-Verilog、VCS、Design Compiler、DFT、Prime time、Quatus、Vivado、Virtuoso、Calibre、Spice、Perl、Tcl
勤務地
東京都大田区羽田空港1-1-4羽田イノベーションシティZoneK2F京急空港線東京モノレール「天空橋」駅直結
年収 年収:800万~1200万程度
月給制:月額614500円
給与:■経験、スキル、年齢を考慮の上、同社規定により優遇
賞与:年2回
昇給:有
勤務時間 9:00~18:00
休日・休暇 年間124日、土日休み、祝日休み、年末年始、夏期休暇、特別休暇等
募集背景 会社の成長に伴う部門強化
福利厚生 通勤手当、引っ越し手当(規定有り)、転居支度金制度、退職金制度、産休・育休制度等
喫煙情報:屋内禁煙
雇用形態 正社員
選考プロセス 書類選考 ⇒ 簡単な適性検査・面接(2回) ⇒ 内定

この求人情報は、「株式会社ワークポート」が取り扱っています

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