DFT回路設計＜半導体集積回路＞ ヌヴォトン テクノロジージャパン
| 職種 | DFT回路設計＜半導体集積回路＞ |
|---|---|
| 社名 | ヌヴォトン テクノロジージャパン |
| 業務内容 |
■同社にて半導体集積回路における下記業務を担当していただきます。 【具体的には】 ■RTL（Verilog-HDL）を用いたデジタル回路設計、検証業務 ■EDAツールを用いたDFT設計、検証業務 ■製品検査用のテストパターン設計 ■検査データ分析、改善運動 ※ご経験に応じて、入社数週間程度に加え、2ヶ月に1回程度技能研修を受けるために本社長岡京への出張がある可能性がございます。 【製品展開】 マイクロコントローラ、MOSFET、アナログIC、DSP／ISP、通信＆インターフェースLSI、イメージセンサ、レーザダイオードなど |
| 求める経験 | 【必須要件】下記いずれかに該当する方 ■RTL（Verilog-HDL）を用いたデジタル回路設計及び検証業務経験 ■EDAツールを用いたDFT設計および検証業務 【歓迎要件】 ■論理合成、タイミング設計などの実務経験（3年以上） ■機能安全に関する知見 ■アナログ・デジタル混載半導体回路設計の知見 |
| 勤務地 |
神奈川県/横浜市
|
| 年収 |
450-1000万円 ※これまでの経験・能力を考慮の上、同社規程に基づき、担当職位の大きさに応じて決定 |
| 勤務時間 | 09:00 - 17:30（コアタイム：00:00 - 00:00） |
| 休日・休暇 | 年間127日／（内訳）完全週休2日制（土日）、祝日、夏季休暇（一斉年休含む）、年末年始、有給休暇、慶事休暇、ファミリーサポート休暇、キャリア開発休暇、長期節目休暇など |
| 福利厚生 |
健康保険、雇用保険、労災保険、厚生年金 通勤手当、超勤手当、育英給付金など 社宅、財形貯蓄、保養所、医療施設、企業年金制度など |
| 雇用形態 | 正社員 |
| 選考プロセス | 【筆記試験】有（SPI） 【面接回数】2回 【選考フロー】 書類選考⇒一次面接⇒SPI⇒最終面接 |
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