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powered by   2025/02/18 更新
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デジタル回路設計 社名非公開

掲載開始日:2025/01/21
終了予定日:2025/02/18
更新日:2025/01/23
ジョブNo.351841
企業名 社名非公開
年収 600万円 〜 1000万円
勤務地
大阪府宮原1丁目1番1号 新大阪阪急ビル
職種 デジタル回路設計
業種 半導体・電子・電気機器業界のデジタル回路設計
ポイント システムLSIのファブレスメーカーです。 現在、液晶コントローラ向けタイミングデバイスや車載向けのLSIに注力しており、さらなる成長が期待できる企業です。 現場のエンジニアから意見を吸い上げ、反映させていく風土があります。
正社員 転勤無し年間休日120日以上フレックス勤務

募集要項

仕事内容 ■OA、FA機器に搭載されるASIC、SOCのデジタル回路設計、検証を担当いただきます。
顧客との仕様整合、CPUやIP(DDR, PCIe,USB,SD,Ether)選定から始まり、社内のレイアウトチームにRTLリリースするまでの一連の作業を実施いただきます。

【具体的には】
※以下のいずれかの職務を実施いただきます。補助、メインはスキルに応じて相談して決定します。
・CPU-バス設計
・IP(PCIe,USB,SD,Ether)受入れとしての設計・検証
・顧客の要望に応じた回路設計・検証
・Chip全体の検証

【職責】
・プロジェクトリーダ(5~20人。協力会社を含む)
・担当モジュールの責任者(規模・難易度により1~5人など変わります)
・上流設計起因でのリメイクの撲滅
・部員の上流設計スキルの底上げ
・上流設計の効率化と、工数低減
求める人材 【必須要件】※以下すべてを満たす方
・5年以上のVerilog-RTL設計および検証の経験
・デジタル回路の仕様策定
・ 組み込みSW開発経験/知識

【歓迎要件】
・自身が担当した上流設計における、上流設計起因でのリメイク発生件数0件
・担当モジュールの責任者の経験
・SoC/大規模FPGA 設計経験
・高速インターフェイス設計またはIP使用経験(PCIe,USB,SD,Ether)

給与・待遇

給与 600-1000万円
※経験・スキル・前職給与を考慮の上優遇
※コアタイム無しのフレックスタイム制です。
雇用・契約形態 正社員
募集ポジション デジタル回路設計
待遇・福利厚生 健康保険、雇用保険、労災保険、厚生年金
通勤手当
前払い退職金制度、労災保険、持株制度、財形貯蓄、リロクラブ加入(提携保養所利用可)、401kプラン

勤務時間・休日

勤務時間 09:00 - 18:00(コアタイム:00:00 - 00:00)
休日・休暇 年間125日/(内訳)完全週休2日制(土、日)、祝日、年末年始、夏季休暇等

その他

選考プロセス 【適性検査】有(性格検査)
【面接回数】2回
【選考フロー】
書類選考⇒適性検査(性格)⇒1次面接⇒最終面接

企業情報

企業名 社名非公開
事業内容 【概要・特徴】
東証プライム上場のLSIファブレスメーカー。
ゲーム機など向けのアミューズメント領域を主力分野としており、LSIの設計、開発から生産までトータルソリューションを提供しています。
同社が製品の設計・開発を行い、国内外の大手ファウンドリーに製造を委託しています。

【研究開発】
研究開発に注力して特許として権利化し、成長の源泉としています。
社員の6割以上がが研究や製品開発を担うエンジニアで、年間研究開発費は20億円以上、特許登録件数は500件以上となっています。

【ビジョン】
IoTやAIなどの技術の急速な世界的進化を成長の機会と捉え、同社では今後、車載分野、産業機器分野、通信インフラ分野、エネルギー制御分野、ロボット分野に注力していく方針です。

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