回路設計・開発取りまとめ＜LSI（FPGA、デジタル/アナログASIC）＞ 社名非公開
| 企業名 | 社名非公開 |
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| 年収 | 600万円 〜 1100万円 |
| 勤務地 |
兵庫県塚口本町8-1-1
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| 職種 | 回路設計・開発取りまとめ＜LSI（FPGA、デジタル/アナログASIC）＞ |
| 業種 | 総合電機業界のシステム設計 |
| ポイント | 最先端の技術を活用した設計支援ツールの開発やシミュレーション技術の研究に取り組んでいます。高度なスキルを磨きながら、社会インフラや産業の未来を支えるプロジェクトに貢献できる環境が整っています。技術者として成長したい方に最適な職場です。 |
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正社員
年間休日120日以上社宅・家賃補助制度フレックス勤務
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募集要項
| 仕事内容 |
同社製品に搭載されるFPGAやデジタル/アナログLSIの回路設計、設計プロセス改善に取組み、同社製品の付加価値向上に貢献する役割を担当します。 【具体的には】 (1)FPGAやASICの仕様策定、開発とりまとめ (2)デジタル回路設計・検証 (3)アナログ回路設計・検証 【詳細】 ■デジタル回路設計技術者 VerilogおよびSystemVerilogを用いたデジタル回路設計検証を主として、ASIC/FPGAの仕様設計や開発管理含めた開発全般に関わる業務を担当して頂きます。 ■アナログ回路設計技術者 EDAツールを用いたアナログ回路・レイアウト設計を主として、ASICの仕様設計や開発管理、テスト開発を含めた開発全般に関わる業務を担当して頂きます。 ＜使用言語、環境、ツール、資格等＞ ■デジタル回路設計技術者 ツール：Siemens/Synopsys/Cadence、AMD-Xilinx/Intel/Lattice/Microchipのうち2種以上 言語：Verilog/SystemVerilog/C ■アナログ回路設計技術者 ツール：Cadence社EDA |
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| 求める人材 | 【必須要件】 ・LSIの設計開発職として3年以上の経験 ■デジタル回路設計技術者 ・VerilogなどHDLでの3年以上の設計経験 ■アナログ回路設計技術者 ・基準電圧源回路、オペアンプ、ADC/DACなどのアナログ回路設計経験 【歓迎要件】 ・英文仕様書の読解が可能なレベルの英語力 ・LSI開発のリーダー経験 ・MATLABなどを用いたモデルベース設計経験 ・LSIの出荷テスト開発経験 ・LSIの不具合解析経験 |
給与・待遇
| 給与 |
600-1060万円 ※経験・役割等による |
|---|---|
| 雇用・契約形態 | 正社員 |
| 募集ポジション | 回路設計・開発取りまとめ＜LSI（FPGA、デジタル/アナログASIC）＞ |
| 待遇・福利厚生 |
健康保険、雇用保険、労災保険、厚生年金 通勤手当、住宅手当、家族手当、時間外手当、外勤手当 ※家賃補助制度：家賃の半額補助（支給上限4.5万円・最大8年間・家族帯同の世帯主のみに適応） ※静岡製作所は社宅はなく既婚者（世帯主で且つ家族帯同で賃貸住宅の場合に限る）は家賃補助、独身者は独身寮となります。 |
勤務時間・休日
| 勤務時間 | 08:30 - 17:00（コアタイム：11:15 - 14:00） |
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| 休日・休暇 | 年間130日／（内訳）週休2日制（土・日）、国民の祝日、労働祭、年末年始(12/31、1/2、1/3)、会社創立記念日(2/1)、8月第1・第2金曜日、他休暇：結婚休暇、転任休暇、忌引休暇、セルフサポート休暇、チャージ休暇、（※2023年度） |
その他
| 選考プロセス | 【筆記試験】有【面接回数】2回 【選考フロー】書類選考→1次選考+筆記試験→最終面接 |
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企業情報
| 企業名 | 社名非公開 |
|---|---|
| 事業内容 |
【概要・特徴】 東証プライム上場、世界規模で事業展開する総合電機メーカー。 連結子会社200社以上を擁するグループの中核企業です。 重電システム・産業メカトロニクス・情報通信システムなどの事業を展開しています。 【注力分野】 電力・交通・ビル・FA・自動車機器などの領域における市場ニーズの取込みや技術開発強化などに注力しています。。 また、コンパクトAI技術や、5G関連技術の開発も強化していく方針です。 【研究施設】 R&Dの中枢として国内に複数の研究所を有し、最新の研究開発に取り組んでいます。 また、海外にも研究拠点を有し、環境・エネルギー技術や通信技術の基礎研究、先進技術の研究開発を行っています。 |
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