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回路設計 に該当する転職・求人一覧
| 勤務地 | ※常駐先による ※常駐先による 勤務地変更の範囲：取引先(案件先)の勤務地により異なる |
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| 年収 | 年収:410万～650万程度 月給制：月額316000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年1回（6月） 昇給:年1回（9月） |
| 業務内容 | 【職務概要】 ご経験に合わせてLSI／FPGAのフロントエンド設計・ミドルエンド設計・バックエンド設計をご担当頂きます。 案件ごとにチームを組み、自社または取引先様企業で作業を行います。自社持ち帰り案件では大阪本社での業務になり、取引先... |
| 求める経験 | 【必須】下記いずれかのご経験がある方 ■デジタルまたはアナログ回路設計・検証の実務経験をお持ちの方 (VerilogHDL／VHDL／SystemVerilogを用いたRTL設計／検証等) ■評価デバッグ経験をお持ちの方 ■ミド... |
| 勤務地 | 広島県広島市中区銀山町4－17－5 ※プロジェクトによる 勤務地変更の範囲：取引先(案件先)の勤務地により異なる |
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| 年収 | 年収:400万～600万程度 月給制：月額225000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年2回 昇給:年1回 |
| 業務内容 | 【職務概要】 デジタル・LSI・制御回路等の設計開発業務を担当していただきます。 ■具体的プロジェクトの例 自動車、家電製品、通信機器、航空宇宙機器等の設計開発及び、解析業務を担当していただきます。具体的には、自動車内外装、駆動系... |
| 求める経験 | 【必須】 ・回路設計実務経験（デジタル・アナログ問わず） 【尚可】 ・FPGA、Verilog-HDL、VHDL、DSP等の設計経験 ・全国転勤可能な方 【こんな方にオススメ】 ■フォロー体制が充実した環境で長期的に就業... |
| 勤務地 | 東京都東村山市久米川町4-24-12 西武新宿線「東村山」駅徒歩8分 勤務地変更の範囲：本社及び全国の事業場、支社、営業所 |
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| 年収 | 年収:400万～600万程度 月給制：月額270000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年2回 昇給:あり |
| 業務内容 | 【職務概要】 FPGA、組込みソフト受託開発等を手掛ける同社の電子回路（FPGA）設計技術者として業務に取り組んでいただきます。 【職務詳細】 ■製品：受託開発 ■範囲：設計、企画、提案、開発、立ち上げ 【具体的には】 ... |
| 求める経験 | 【必須】 普通自動車運転免許をお持ちで下記いずれかの経験 ・回路設計（デジタル、アナログ） ・FPGA設計 ・OS組込み ・ドライバー設計 ■働き方 お客様は日本全国内で、直近では山梨、名古屋、大阪、熊本への出張がございま... |
| 勤務地 | 東京都東村山市久米川町4-24-12 西武新宿線「東村山」駅徒歩8分 勤務地変更の範囲：本社及び全国の事業場、支社、営業所 |
|---|---|
| 年収 | 年収:400万～600万程度 月給制：月額270000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年2回 昇給:あり |
| 業務内容 | 【職務概要】 FPGA、組込みソフト受託開発等を手掛ける同社のソフトウェア設計技術者として業務に取り組んでいただきます。 【職務詳細】 ■製品：画像処理プロセッサ ■範囲：設計、調整 ■開発：C言語 【具体的には】 ・... |
| 求める経験 | 【必須】 普通自動車運転免許をお持ちで下記いずれかの経験 ・C言語による開発／ソフト開発設計 ・OS組込み（ITRON, Linux, VxWorks, 等） ・ドライバー（開発した基板のドライバー、組込みOS、Windows、Li... |
| 勤務地 | 神奈川県横浜市都筑区佐江戸町600 JR横浜線「鴨居」駅から徒歩約7分 |
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| 年収 | 年収:550万～980万程度 月給制：月額300000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年2回（7月・12月） 昇給:年1回（4月） |
| 業務内容 | 【職務概要】 主な担当業務はテラヘルツ帯をターゲットとした先行的な研究開発です。 テラヘルツ帯は新たな周波数領域であるため、業界においても民生用途向けの技術蓄積が十分ではありません。 同社の新規材料やデバイスを活かしたテラヘルツ帯無線... |
| 求める経験 | 【必須】 ・高周波デバイスに関する専門技術（無線モジュール、半導体回路、基板設計のいずれか一つ以上） ・関連する研究開発の経験（3年以上） ・複数回の学会発表、特許出願の実績 【尚可】 ・ミリ波／テラヘルツ帯を扱った経験 ・... |
| 勤務地 | 神奈川県横浜市神奈川区金港町2-6 横浜プラザビル7階 各線「横浜」駅徒歩5分 勤務地変更の範囲：本社及び全国の事業場、支社、営業所 |
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| 年収 | 年収:700万～1200万程度 月給制：月額410000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年2回 昇給:年1回 |
| 業務内容 | 【職務概要】 同社SSD製品の設計業務を担当頂きます。サーバー／データセンター／産業機器向け等、幅広く展開されるSSD製品の共通基盤技術開発を担います。ご経験・ご志向にあわせて下記業務をお任せします。 ※PM経験者や数十年単位でエン... |
| 求める経験 | 【必須】 ■エンジニアとしての20年以上の経験もしくはプロジェクトマネージャーの経験 ■下記のいずれかの経験 ・システム回路設計(実装基板)経験 ・電磁界解析ツール(S-NAP、HFSS,SIwaveなど)での解析(SI or PI... |
| 勤務地 | プロジェクト先による プロジェクト先による 勤務地変更の範囲：取引先(案件先)の勤務地により異なる |
|---|---|
| 年収 | 年収:410万～610万程度 月給制：月額316000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年1回（6月） 昇給:年1回（9月） |
| 業務内容 | 【職務概要】 ご経験に合わせてLSI／FPGAのフロントエンド設計・ミドルエンド設計・バックエンド設計をご担当頂きます。 案件ごとにチームを組み、自社または取引先様企業で作業を行います。自社持ち帰り案件では大阪本社での業務になり、取引先... |
| 求める経験 | 【必須】下記いづれかのご経験がある方 ■デジタルまたはアナログ回路設計・検証の実務経験をお持ちの方 (VerilogHDL／VHDL／SystemVerilogを用いたRTL設計／検証等) ■評価デバッグ経験をお持ちの方 ■ミド... |
| 勤務地 | プロジェクト先による プロジェクト先による 勤務地変更の範囲：取引先(案件先)の勤務地により異なる |
|---|---|
| 年収 | 年収:410万～610万程度 月給制：月額316000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年1回（6月） 昇給:年1回（9月） |
| 業務内容 | 【職務概要】 ご経験に合わせてLSI／FPGAのフロントエンド設計・ミドルエンド設計・バックエンド設計をご担当頂きます。 案件ごとにチームを組み、自社または取引先様企業で作業を行います。自社持ち帰り案件では大阪本社での業務になり、取引先... |
| 求める経験 | 【必須】下記いずれかのご経験がある方 ■デジタルまたはアナログ回路設計・検証の実務経験をお持ちの方 (VerilogHDL／VHDL／SystemVerilogを用いたRTL設計／検証等) ■評価デバッグ経験をお持ちの方 ■ミド... |
| 勤務地 | プロジェクト先による プロジェクト先による 勤務地変更の範囲：取引先(案件先)の勤務地により異なる |
|---|---|
| 年収 | 年収:410万～610万程度 月給制：月額316000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年1回（6月） 昇給:年1回（9月） |
| 業務内容 | 【職務概要】 ご経験に合わせてLSI／FPGAのフロントエンド設計・ミドルエンド設計・バックエンド設計をご担当頂きます。 案件ごとにチームを組み、自社または取引先様企業で作業を行います。自社持ち帰り案件では大阪本社での業務になり、取引先... |
| 求める経験 | 【必須】下記いずれかのご経験がある方 ■デジタルまたはアナログ回路設計・検証の実務経験をお持ちの方 (VerilogHDL／VHDL／SystemVerilogを用いたRTL設計／検証等) ■評価デバッグ経験をお持ちの方 ■ミド... |
| 勤務地 | プロジェクト先による プロジェクト先による 勤務地変更の範囲：取引先(案件先)の勤務地により異なる |
|---|---|
| 年収 | 年収:410万～650万程度 月給制：月額316000円 給与:■経験、スキル、年齢を考慮の上、同社規定により優遇 賞与:年1回（6月） 昇給:年1回（9月） |
| 業務内容 | 【職務概要】 ご経験に合わせてLSI／FPGAのフロントエンド設計・ミドルエンド設計・バックエンド設計をご担当頂きます。 案件ごとにチームを組み、自社または取引先様企業で作業を行います。自社持ち帰り案件では大阪本社での業務になり、取引先... |
| 求める経験 | 【必須】下記いずれかのご経験がある方 ■デジタルまたはアナログ回路設計・検証の実務経験をお持ちの方 (VerilogHDL／VHDL／SystemVerilogを用いたRTL設計／検証等) ■評価デバッグ経験をお持ちの方 ■ミド... |
